IRIGtimeM: IRIG-B主站IP核

IRIGtimeM 在 FPGA 设备上实现符合 IRIG 200-04 标准的时间同步主站。该 IRIG-B 主 IP 旨在支持所有 IRIG-B 编码表达式以及 DCLS 和 AM 调制,以提供最大的灵活性。

该 IRIG-B 主 IP 每秒生成 IRIG-B 帧,包括强制性和可选时间信息(秒、分、小时、天、年、控制功能和二进制直秒),具体取决于配置上选择的 IRIG-B 时间码。该 IP 旨在提供自主操作,需要尽可能少的配置。

主要特点

  • 符合 IRIG 200-04 标准的时间同步主站
  • 支持 DCLS 和 AM 调制
  • 支持所有 IRIG-B 编码表达式,包括年份信息、控制函数和直二进制秒
  • 输出类型(IRIG-B 时间码)可在实现之前和动态中配置
  • 精确的 IRIG-B 输出,以提供纳秒级精度
  • 用于 IP 初始设置的 32 位时间戳输入
  • 用于测试的周期性脉冲输出

想了解更多信息,欢迎通过info@intelnect.com联系虹科

IRIGtimeM IP core框图

支持的 Xilinx FPGA 系列和评估板

通过利用新的 Xilinx Vivado 工具可以轻松集成IP核到您的 FPGA 设计中,该工具允许在图形用户界面中使用 IP 核并以简单的方式配置 IP 参数。

IRIGtimeM 在以下 Xilinx FPGA 系列上受支持:

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